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③APB总线的输入信号和输出信号:此主要用于APB总线控制、IP核选

来源:未知作者:admin 更新时间:2018-04-19 16:08
①体系时钟与复位旌旗灯号:是全部LEON3架构所共用的时钟旌旗灯号和复位旌旗灯号,而iCLK_50是由外部直接引入的频次为50MHz的时钟,未颠末PLL处理。 ③APB总线的输出旌旗灯号和输出旌旗灯号:此旌旗灯号主要用于APB总线控制、IP核选择、IP核使能等,其中搜罗

  ①体系时钟与复位旌旗灯号:是全部LEON3架构所共用的时钟旌旗灯号和复位旌旗灯号,而iCLK_50是由外部直接引入的频次为50MHz的时钟,未颠末PLL处理。

  ③APB总线的输出旌旗灯号和输出旌旗灯号:此旌旗灯号主要用于APB总线控制、IP核选择、IP核使能等,其中搜罗对IP核外部存放器的设置都是经由过程APB总线旌旗灯号来实现的。

  ④D5M摄像头输出旌旗灯号和输出旌旗灯号:此旌旗灯号主要实现对D5M摄像头的设置装备陈设和数据收集。

  ⑤LTM表现器输出旌旗灯号和输出旌旗灯号:此旌旗灯号用于对LTM表现器的设置装备陈设。由于基于APB总线M摄像头、LTM表现器和边沿检测算法于一体,以是外部接口旌旗灯号绝对较多。但就APB总线自己而言,其旌旗灯号并未几,这也是基于APB总线的假想方法绝对简略的启事。

  相干“基于APB核心低速总线图象检测IP核的实现基础思惟部分”略编者注。

  文中首先把持Matlab验证局域熵边沿检测算法假想的准确性,而后采纳Verilog HDL硬件描写语言编写图象边沿检测算法,在算法实现过程当中,为进步算法的性能,采纳了Quartus II中自带的DSP加速宏模块。同时,为验证仿真算法的准确性,编写Testbench体系测试文件,对其停止仿线为局域熵边沿检测算法的硬件仿线局域熵边沿检测算法硬件实现仿线为采纳片上缓存的方法实现的三行数据的同步。X1~X9对应3×3窗口中的9个像素点。图中终极的数据输出是有必定时延的,这是由于算法中具备大批的乘加运算和浮点数运算构成的。在实现算法的同时,考虑到所选芯片供给了可用于加速算术运算的DSP模块,因而为了加速算法的处理速率,在算法实现过程当中,插足了大批的DSP加速处理模块,如乘加器,浮点除法器等。表1给出了用硬件语言实现上述算法所应用的芯片本钱环境。表2给出了该算法对DSP加速模块的应用环境。

  测试采纳的硬件开拓平台为FPGA CycloneIIEP2C70F896C6N,Quartus II版本为10.0(32位),LEON3开拓包版本为grlib-gp1-1.0.22-b4095.zip.D5M摄像头事情在25MHz频次,所收集的图象分辩率为400×240,R、G、B每种颜色以10-bit二进制数据表示,D5M摄像头每秒收集22~25帧图象。LTM表现屏的表现分辩率为400×240,事情在33MHz频次。

  且由实际测试可知,在外界环境适中的前提下,体系可以或许获得很好的图象边沿检测结果。但由于图象的分辩率较大,而边沿检测算法中所采纳的窗口为3×3,绝对于图象来讲较小,以是图象上的一些小的阴影地区也会被检测进去,组成阴影地区滋扰,影响图象的边沿检测结果。但整体来讲,实现了静态图象边沿提取的终极目的。

  测验考试结果剖明该SoC体系事情一样平常,可以或许实现每秒22~25帧,最好分辩率为400×240和640×480的静态图象边沿检测功效,均匀数据延时在70~80个体系时钟。体系具备很好的可移植性与可设置装备陈设性,占用本钱少,速率快,具备广泛的应用远景。

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